IC設(shè)計工程師

面議

上海碩士研究生 1人 2024-12-26發(fā)布查看公告詳情

競爭力分析

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職位詳情

基本信息

職位名稱：IC設(shè)計工程師

職位類型：實驗技術(shù)崗

工作地點：上海

招聘人數(shù)： 1

報名方式：網(wǎng)上系統(tǒng)

截止時間：詳見正文

用人部門：信息學(xué)院教學(xué)中心

其他要求

學(xué)歷要求：碩士研究生

需求專業(yè)：

電子科學(xué)與技術(shù)

該需求專業(yè)僅展示一級學(xué)科

崗位職責(zé)

1.負責(zé)或協(xié)助IC設(shè)計類實驗課程的開設(shè)，如《基于FPGA的硬件系統(tǒng)設(shè)計》、《數(shù)字VLSI設(shè)計》、《數(shù)字集成電路I》和《數(shù)字集成電路II》等；
2.負責(zé)IC設(shè)計方面應(yīng)用實踐培訓(xùn)課程的管理與輔助授課；
3.負責(zé)IC設(shè)計相關(guān)教學(xué)實驗室的安全及使用管理、軟件和設(shè)備的維護和管理；
4.負責(zé)采購和管理IC設(shè)計相關(guān)的軟件、設(shè)備和耗材；
5.負責(zé)培訓(xùn)學(xué)生以及其他科研工作人員使用IC設(shè)計相關(guān)軟件及儀器；
6.負責(zé)建立和完善IC設(shè)計實驗室儀器的使用章程和規(guī)范；
7.學(xué)院交付的其它相關(guān)工作

任職要求

1.具有微電子相關(guān)領(lǐng)域的碩士或博士學(xué)歷；
2.具有2年及以上從事IC前端設(shè)計工作經(jīng)歷者優(yōu)先考慮；
3.對半導(dǎo)體器件的工作原理和測試有基本的了解；
4.精通VHDL/Verilog程序編寫，能幫助學(xué)生搭建自動化的測試平臺，滿足其測試要求；
5.精通Cadence/Synopsys等IC設(shè)計前段設(shè)計相關(guān)工具；
6.熟悉FPGA設(shè)計工具和流程者優(yōu)先考慮；
7.具有良好的團隊合作精神，善于溝通；
8.能夠閱讀相關(guān)專業(yè)的英語文獻，具有一定的研究能力。

其他說明

工作條件與工資待遇
按照上?？萍即髮W(xué)相關(guān)規(guī)定執(zhí)行，根據(jù)個人具體情況，提供具有競爭力的薪酬、津貼和福利。

競爭力分析

解鎖詳細分析

您與該職位匹配度: ***，已超過了 *** 的競爭者，建議************

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一般

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