FPGA研發(fā)工程師

面議

北京碩士研究生 3-5年 1人 2025-01-20發(fā)布查看公告詳情

競爭力分析

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職位詳情

基本信息

職位名稱：FPGA研發(fā)工程師

職位類型：其他科研支撐崗

工作地點：北京

招聘人數(shù)： 1

報名方式：電子郵件

截止時間：詳見正文

用人部門：信息化前瞻技術(shù)研究開放實驗室

其他要求

學歷要求：碩士研究生

工作經(jīng)驗：3-5年

需求專業(yè)：

電子科學與技術(shù), 信息與通信工程, 計算機科學與技術(shù)

該需求專業(yè)僅展示一級學科

崗位職責

1、負責FPGA系統(tǒng)設(shè)計、關(guān)鍵技術(shù)研發(fā)，參與項目需求分析，調(diào)研論證并落實項目技術(shù)細節(jié)，牽頭系統(tǒng)模塊的詳細設(shè)計；
2、獨立負責較復雜FPGA單元架構(gòu)設(shè)計和RTL設(shè)計驗證，完成FPGA系統(tǒng)仿真和板級調(diào)試及系統(tǒng)調(diào)試，撰寫FPGA架構(gòu)及單元模塊設(shè)計和驗證文檔；
3、分析并解決開發(fā)、調(diào)試過程中遇到的問題；
4、完成領(lǐng)導交代的其他工作。

任職要求

1、碩士及以上學歷，電子、微電子、通信、計算機科學等相關(guān)專業(yè)背景；
2、具備網(wǎng)絡(luò)研發(fā)背景及3年（含）以上FPGA/ASIC開發(fā)經(jīng)驗；
3、熟悉Altera/Xilinx/Lattice等公司芯片開發(fā)環(huán)境及仿真調(diào)試工具；
4、精通VerilogHDL語言和時序約束、時序分析、時序優(yōu)化方法；
5、具有良好的表達溝通能力和文檔書寫能力、良好的協(xié)作意識和團隊合作精神；
6、具有網(wǎng)絡(luò)芯片架構(gòu)設(shè)計經(jīng)驗者優(yōu)先；
7、具備航天項目研發(fā)或國產(chǎn)CPU芯片研發(fā)經(jīng)驗者優(yōu)先。

其他說明

將有關(guān)材料（電子版）發(fā)送至郵箱，郵件主題欄注明：“崗位名稱-姓名-專業(yè)”。

競爭力分析

解鎖詳細分析

您與該職位匹配度: ***，已超過了 *** 的競爭者，建議************

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