工程師

面議

成都本科 5-10年 2人 2026-03-27發(fā)布查看公告詳情

競爭力分析

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職位詳情

基本信息

職位名稱：工程師

職位類型：技術(shù)支撐崗

工作地點(diǎn)：四川成都

招聘人數(shù)： 2

報(bào)名方式：電子郵件

截止時(shí)間：2026-04-02

用人部門：第六教研室

其他要求

學(xué)歷要求：本科

工作經(jīng)驗(yàn)：5-10年

崗位職責(zé)

1.對整個(gè)產(chǎn)品的生命周期內(nèi)的FPGA設(shè)計(jì)負(fù)責(zé)；
2.根據(jù)項(xiàng)目需要開展產(chǎn)品FPGA設(shè)計(jì)技術(shù)評審，能夠獨(dú)立策劃項(xiàng)目方案并完成方案論證；
3.負(fù)責(zé)高速數(shù)據(jù)采集系統(tǒng)中的數(shù)據(jù)存儲、傳輸及處理等功能模塊的邏輯代碼總體設(shè)計(jì)；
4.代碼規(guī)范制定，代碼評定及核心FPGA代碼編寫；
5.培養(yǎng)團(tuán)隊(duì)，提升團(tuán)隊(duì)整體技能和協(xié)作水平;
6.帶領(lǐng)其他工程師完成所有開發(fā)任務(wù);
7.帶領(lǐng)軟件團(tuán)隊(duì)攻克技術(shù)難題，對FPGA的可靠性負(fù)責(zé)，對開發(fā)進(jìn)度負(fù)責(zé)；
8.完成教研室交辦的其他任務(wù)。

任職要求

專業(yè)要求：電子、通信、自動化等專業(yè)本科及以上學(xué)歷。
工作經(jīng)驗(yàn)：至少五年數(shù)字電路設(shè)計(jì)從業(yè)經(jīng)驗(yàn)。
1.精通Verilog語言；
2.熟悉AD數(shù)據(jù)采集存儲系統(tǒng)開發(fā)經(jīng)驗(yàn)；
3.JESD204B、Seders、GTX、PCle傳輸，DDR控制器等相關(guān)研發(fā)經(jīng)驗(yàn)者優(yōu)先；
4.有較強(qiáng)的團(tuán)隊(duì)協(xié)作能力和溝通能力，有一定管理能力；
5.身心健康，具有履行崗位職責(zé)所需的身體條件。

其他說明

有意者請于2026年4月2日下午17:00前將個(gè)人簡歷及相關(guān)證明材料發(fā)至郵箱，文件命名格式為“二級單位聘用人員應(yīng)聘+姓名+聯(lián)系電話”。

競爭力分析

解鎖詳細(xì)分析

您與該職位匹配度: ***，已超過了 *** 的競爭者，建議************

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一般

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